Niveau décalage entre TTL et CMOS (3 / 10 étapes)

Étape 3: Le problème défini : changement de niveau

Chaque famille logique définit les seuils appropriés de quoi il envisagera un haut ou un bas.  Ce choix étant quelque peu arbitraire, ils le faire fermer.  Généralement, un creux est un signal d’une amplitude de zéro à un volt.  Un sommet varie le plus et est la cause de notre niveau actuel déplacement consternation.

La famille TTL permet un 2V - 5V différence soit considéré comme un sommet et définit le seuil de sortie pour la grande sous 2, 7V à 5V.  Dans la famille CMOS, une entrée de vouloir définir la haute doit apporter entre 3,5 v et 5 v.  Mais TTL n’a qu’à apporter 2, 7V, laissant une différence de presque une volt qui est valide pour le TTL et non valide pour le CMOS.  C’est quand un circuit TTL veut envoyer une haute et sources quelque part dans cette gamme de nébuleuse qui n’est pas valide pour le CMOS haute mais qui est pour le TTL.

La réponse est de décalage de niveau.  Il s’agit de la Loi d’activement soit déplacer vers le bas ou vers le haut une tension de signal pour correspondre à une cible IC. Le plus utile que j’ai trouvé est le passage jusqu'à 5V de 3.3V signal.

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